LG Electronics 32LS5600/560S/560T-ZC S7LR2DIVXMS10, GP4LS7LR22011/06/03 DDR25612, IC1201

AVDD_DDR0

AVDD_DDR0

AVDD_DDR0

AVDD_DDR0

R1201

1%1K

R1204

R1224

1%1K

R1227

+1.5V_DDR

AVDD_DDR0

1%1K

OS

1%1K

OS

L1202

A-MVREFDQ

B-MVREFCA

B-MVREFDQ

CIC21J501NE

0.1uF

1000pF

A-MVREFCA

1000pF

0.1uF

1000pF

0.1uF

0.1uF

1000pF

R1202

1%1K

C1201

C1202

R1205

1%1K

C1203

C1204

C1247

C1248

OS 1%1K

R1225

C1249

C1250

OS 1%1K

R1228

C1251

10uF C1206

0.1uF C1239

0.1uF

C1217

1uF

C1218

1uF

C1219

1uF

C1238

1uF

C1241

1uF

C1220

0.1uF

OS

OS

OS

OS

OPT

CLose to DDR3 CLose to Saturn7M IC CLose to Saturn7M IC CLose to DDR3

					EAN61828901
					IC1201
					H5TQ1G63DFR-H9C
					DDR_1333_HYNIX
A-MVREFCA				M8						N3
					VREFCA				A0
										P7
									A1
										P3
				H1					A2
A-MVREFDQ										N2
					VREFDQ				A3
										P8
									A4
										P2
			R1203	L8					A5
										R8
					ZQ				A6
		240								R2
AVDD_DDR0		1%							A7
										T8
				B2					A8
										R3
					VDD_1				A9
C1205		10uF		D9						L7
					VDD_2	A10/AP
C1207		0.1uF		G7						R7
					VDD_3			A11
C1208		0.1uF		K2						N7
					VDD_4	A12/BC
C1210		0.1uF		K8						T3
					VDD_5			A13
C1211		0.1uF		N1
					VDD_6					M7
C1212		0.1uF		N9			NC_5
					VDD_7
C1213		0.1uF		R1
					VDD_8					M2
C1214		0.1uF		R9
					VDD_9			BA0
C1215		0.1uF								N8
								BA1
C1216		0.1uF								M3
	OS			A1				BA2
					VDDQ_1					J7
				A8
					VDDQ_2				CK
				C1						K7
					VDDQ_3				CK
				C9						K9
					VDDQ_4			CKE
				D2
					VDDQ_5					L2
				E9
									CS
					VDDQ_6					K1
				F1
					VDDQ_7			ODT
				H2						J3
					VDDQ_8			RAS
				H9						K3
					VDDQ_9			CAS
										L3
				J1					WE
					NC_1					T2
				J9
					NC_2	RESET
				L1
					NC_3
				L9
					NC_4					F3
	A-MA14			T7
					NC_6		DQSL
										G3
							DQSL
				A9						C7
					VSS_1		DQSU
				B3						B7
					VSS_2		DQSU
				E1
					VSS_3					E7
				G8
					VSS_4			DML
				J2						D3
					VSS_5			DMU
				J8
					VSS_6					E3
				M1
					VSS_7		DQL0
				M9						F7
					VSS_8		DQL1
				P1						F2
					VSS_9		DQL2
				P9						F8
					VSS_10		DQL3
				T1						H3
					VSS_11		DQL4
				T9						H8
					VSS_12		DQL5
										G2
							DQL6
										H7
				B1			DQL7
					VSSQ_1					D7
				B9
					VSSQ_2		DQU0
				D1						C3
					VSSQ_3		DQU1
				D8						C8
					VSSQ_4		DQU2
				E2						C2
					VSSQ_5		DQU3
				E8						A7
					VSSQ_6		DQU4
				F9						A2
					VSSQ_7		DQU5
				G1						B8
					VSSQ_8		DQU6
				G9						A3
					VSSQ_9		DQU7

A-MA0

A-MA1

A-MA2

A-MA3

A-MA4

A-MA5

A-MA6

A-MA7

A-MA8

A-MA9

A-MA10

A-MA11

A-MA12

A-MA13

A-MBA0	R1235	56	1%		A-MCK
A-MBA2
A-MBA1
	R1236			C1209
		56	1%	0.01uF
				50V
A-MCKE
					A-MCKB

A-MODT

A-MRASB AVDD_DDR0

A-MCASB R1231 A-MWEB10K

A-MRESETB

A-MDQSL

A-MDQSLB

A-MDQSU

A-MDQSUB

A-MDML

A-MDMU

A-MDQL0

A-MDQL1

A-MDQL2

A-MDQL3

A-MDQL4

A-MDQL5

A-MDQL6

A-MDQL7

A-MDQU0

A-MDQU1

A-MDQU2

A-MDQU3

A-MDQU4

A-MDQU5

A-MDQU6

A-MDQU7

IC101

LGE2111A-T8

S7LR2_DIVX_MS10

A-MA0	A11			B23
		A_DDR3_A[0]	B_DDR3_A[0]		B-MA0
A-MA1	C14			D25
		A_DDR3_A[1]	B_DDR3_A[1]		B-MA1
	B11			F22
A-MA2		A_DDR3_A[2]	B_DDR3_A[2]		B-MA2
A-MA3	F12			G22
		A_DDR3_A[3]	B_DDR3_A[3]		B-MA3
	C15			E24
A-MA4		A_DDR3_A[4]	B_DDR3_A[4]		B-MA4
A-MA5	E12			F21
		A_DDR3_A[5]	B_DDR3_A[5]		B-MA5
	A14			E23
A-MA6		A_DDR3_A[6]	B_DDR3_A[6]		B-MA6
	D11			D22
A-MA7		A_DDR3_A[7]	B_DDR3_A[7]		B-MA7
A-MA8	B14			D24
		A_DDR3_A[8]	B_DDR3_A[8]		B-MA8
	D12			D21
A-MA9		A_DDR3_A[9]	B_DDR3_A[9]		B-MA9
	C16			C24
A-MA10		A_DDR3_A[10]	B_DDR3_A[10]		B-MA10
	C13			C25
A-MA11		A_DDR3_A[11]	B_DDR3_A[11]		B-MA11
A-MA12	A15			F23
		A_DDR3_A[12]	B_DDR3_A[12]		B-MA12
	E11			E21
A-MA13		A_DDR3_A[13]	B_DDR3_A[13]		B-MA13
	B13			D23
A-MA14		A_DDR3_A[14]	B_DDR3_A[14]		B-MA14
	F13			G20
A-MBA0		A_DDR3_BA[0]	B_DDR3_BA[0]		B-MBA0
	B15			F24
A-MBA1		A_DDR3_BA[1]	B_DDR3_BA[1]		B-MBA1
	E13			F20
A-MBA2		A_DDR3_BA[2]	B_DDR3_BA[2]		B-MBA2
	C17			G25
A-MCK		A_DDR3_MCLK	B_DDR3_MCLK		B-MCK
	A17			G23
A-MCKB		A_DDR3_MCLKZ	B_DDR3_MCLKZ		B-MCKB
	B16			F25
A-MCKE		A_DDR3_MCLKE	B_DDR3_MCLKE		B-MCKE
	E14			D20
A-MODT		A_DDR3_ODT	B_DDR3_ODT		B-MODT
A-MRASB	B12			B25
		A_DDR3_RASZ	B_DDR3_RASZ		B-MRASB
	A12			B24
A-MCASB		A_DDR3_CASZ	B_DDR3_CASZ		B-MCASB
A-MWEB	C12			A24
		A_DDR3_WEZ	B_DDR3_WEZ		B-MWEB
	F11			E20
A-MRESETB		A_DDR3_RESET	B_DDR3_RESET		B-MRESETB
A-MDQSL	B19			K24
		A_DDR3_DQSL	B_DDR3_DQSL		B-MDQSL
	C18			K25
A-MDQSLB		A_DDR3_DQSLB	B_DDR3_DQSLB		B-MDQSLB
A-MDQSU	B18			J21
		A_DDR3_DQSU	B_DDR3_DQSU		B-MDQSU
	A18			J20
A-MDQSUB		A_DDR3_DQSUB	B_DDR3_DQSUB		B-MDQSUB
	E15			H24
A-MDML		A_DDR3_DQML	B_DDR3_DQML		B-MDML
A-MDMU	A21			L20
		A_DDR3_DQMU	B_DDR3_DQMU		B-MDMU
	D17			L23
A-MDQL0		A_DDR3_DQL[0]	B_DDR3_DQL[0]		B-MDQL0
	G15			J24
A-MDQL1		A_DDR3_DQL[1]	B_DDR3_DQL[1]		B-MDQL1
A-MDQL2	B21			L24
		A_DDR3_DQL[2]	B_DDR3_DQL[2]		B-MDQL2
A-MDQL3	F15			J23
		A_DDR3_DQL[3]	B_DDR3_DQL[3]		B-MDQL3
	B22			M24
A-MDQL4		A_DDR3_DQL[4]	B_DDR3_DQL[4]		B-MDQL4
	F14			H23
A-MDQL5		A_DDR3_DQL[5]	B_DDR3_DQL[5]		B-MDQL5
	A22			M23
A-MDQL6		A_DDR3_DQL[6]	B_DDR3_DQL[6]		B-MDQL6
	D15			K23
A-MDQL7		A_DDR3_DQL[7]	B_DDR3_DQL[7]		B-MDQL7
	G16			G21
A-MDQU0		A_DDR3_DQU[0]	B_DDR3_DQU[0]		B-MDQU0
	B20			L22
A-MDQU1		A_DDR3_DQU[1]	B_DDR3_DQU[1]		B-MDQU1
	F16			H22
A-MDQU2		A_DDR3_DQU[2]	B_DDR3_DQU[2]		B-MDQU2
A-MDQU3	C21			K20
		A_DDR3_DQU[3]	B_DDR3_DQU[3]		B-MDQU3
	E16			H20
A-MDQU4		A_DDR3_DQU[4]	B_DDR3_DQU[4]		B-MDQU4
	A20			L21
A-MDQU5		A_DDR3_DQU[5]	B_DDR3_DQU[5]		B-MDQU5
	D16			H21
A-MDQU6		A_DDR3_DQU[6]	B_DDR3_DQU[6]		B-MDQU6
A-MDQU7	C20			K21
		A_DDR3_DQU[7]	B_DDR3_DQU[7]		B-MDQU7

								B-MA0
								B-MA1
								B-MA2
								B-MA3
								B-MA4
								B-MA5
								B-MA6
								B-MA7
								B-MA8
								B-MA9
							B-MA10
							B-MA11
							B-MA12
							B-MA13
B-MCK										B-MBA0
					OS					B-MBA1
						1%	56	R1237		B-MBA2
OS C1240
	0.01uF					1%	56	R1238
					OS				B-MCKE
		50V
B-MCKB
							B-MODT
AVDD_DDR0							B-MRASB
							B-MCASB
		R1232					B-MWEB
				10K
			OS			B-MRESETB

B-MDQSL

B-MDQSLB

B-MDQSU

B-MDQSUB

B-MDML

B-MDMU

B-MDQL0

B-MDQL1

B-MDQL2

B-MDQL3

B-MDQL4

B-MDQL5

B-MDQL6

B-MDQL7

B-MDQU0

B-MDQU1

B-MDQU2

B-MDQU3

B-MDQU4

B-MDQU5

B-MDQU6

B-MDQU7

EAN61828901

IC1202

H5TQ1G63DFR-H9C

		DDR_1333_HYNIX
N3				M8
	A0		VREFCA
P7
	A1
P3
	A2			H1
N2
	A3		VREFDQ
P8
	A4
P2
	A5			L8
R8
	A6		ZQ
R2
	A7
T8
	A8			B2
R3
	A9		VDD_1
L7				D9
	A10/AP		VDD_2
R7				G7
	A11		VDD_3
N7				K2
	A12/BC		VDD_4
T3				K8
	A13		VDD_5
				N1
M7			VDD_6
				N9
	NC_5		VDD_7
				R1
M2			VDD_8
				R9
	BA0		VDD_9
N8
	BA1
M3
	BA2			A1
J7			VDDQ_1
				A8
	CK		VDDQ_2
K7				C1
	CK		VDDQ_3
K9				C9
	CKE		VDDQ_4
				D2
L2			VDDQ_5
				E9
	CS		VDDQ_6
K1				F1
	ODT		VDDQ_7
J3				H2
	RAS		VDDQ_8
K3				H9
	CAS		VDDQ_9
L3
	WE			J1
			NC_1
T2				J9
	RESET		NC_2	L1
			NC_3
				L9
			NC_4
F3				T7
	DQSL		NC_6
G3
	DQSL
C7				A9
	DQSU		VSS_1
B7				B3
	DQSU		VSS_2
				E1
E7			VSS_3
				G8
	DML		VSS_4
D3				J2
	DMU		VSS_5
				J8
E3			VSS_6
				M1
	DQL0		VSS_7
F7				M9
	DQL1		VSS_8
F2				P1
	DQL2		VSS_9
F8				P9
	DQL3		VSS_10
H3				T1
	DQL4		VSS_11
H8				T9
	DQL5		VSS_12
G2
	DQL6
H7
	DQL7			B1
D7			VSSQ_1
				B9
	DQU0		VSSQ_2
C3				D1
	DQU1		VSSQ_3
C8				D8
	DQU2		VSSQ_4
C2				E2
	DQU3		VSSQ_5
A7				E8
	DQU4		VSSQ_6
A2				F9
	DQU5		VSSQ_7
B8				G1
	DQU6		VSSQ_8
A3				G9
	DQU7		VSSQ_9

B-MVREFCA

B-MVREFDQ

OS

R1226

240

1% AVDD_DDR0

C1227 10uF

OSC1228 0.1uF

OSC1229 0.1uF

OSC1230 0.1uF

OSC1231 0.1uF

OSC1232 0.1uF

OSC1233 0.1uF

OSC1234 0.1uF

OSC1235 0.1uF

OSC1236 0.1uF

B-MA14

		IC1201-*1					IC1202-*1
	K4B1G1646G-BCH9					K4B1G1646G-BCH9
		DDR_1333_SS_NEW						DDR_1333_SS_NEW
N3				M8	N3				M8
	A0		VREFCA			A0		VREFCA
P7					P7
	A1					A1
P3					P3
	A2			H1		A2			H1
N2					N2
	A3		VREFDQ			A3		VREFDQ
P8					P8
	A4					A4
P2					P2
	A5			L8		A5			L8
R8					R8
	A6		ZQ			A6		ZQ
R2					R2
	A7					A7
T8					T8
	A8			B2		A8			B2
R3					R3
	A9		VDD_1	D9		A9		VDD_1	D9
L7					L7
	A10/AP		VDD_2	G7		A10/AP		VDD_2	G7
R7					R7
	A11		VDD_3			A11		VDD_3
N7				K2	N7				K2
	A12/BC		VDD_4	K8		A12/BC		VDD_4	K8
T3					T3
	A13		VDD_5	N1		A13		VDD_5	N1
			VDD_6					VDD_6
M7				N9	M7				N9
	NC_5		VDD_7	R1		NC_5		VDD_7	R1
			VDD_8					VDD_8
M2				R9	M2				R9
	BA0		VDD_9			BA0		VDD_9
N8					N8
	BA1					BA1
M3					M3
	BA2		VDDQ_1	A1		BA2		VDDQ_1	A1
J7				A8	J7				A8
	CK		VDDQ_2			CK		VDDQ_2
K7				C1	K7				C1
	CK		VDDQ_3	C9		CK		VDDQ_3	C9
K9					K9
	CKE		VDDQ_4	D2		CKE		VDDQ_4	D2
			VDDQ_5					VDDQ_5
L2				E9	L2				E9
	CS		VDDQ_6	F1		CS		VDDQ_6	F1
K1					K1
	ODT		VDDQ_7			ODT		VDDQ_7
J3				H2	J3				H2
	RAS		VDDQ_8			RAS		VDDQ_8
K3				H9	K3				H9
	CAS		VDDQ_9			CAS		VDDQ_9
L3					L3
	WE		NC_1	J1		WE		NC_1	J1
T2				J9	T2				J9
	RESET		NC_2	L1		RESET		NC_2	L1
			NC_3					NC_3
				L9					L9
			NC_4					NC_4
F3				T7	F3				T7
	DQSL		NC_6			DQSL		NC_6
G3					G3
	DQSL					DQSL
C7				A9	C7				A9
	DQSU		VSS_1			DQSU		VSS_1
B7				B3	B7				B3
	DQSU		VSS_2	E1		DQSU		VSS_2	E1
			VSS_3					VSS_3
E7				G8	E7				G8
	DML		VSS_4	J2		DML		VSS_4	J2
D3					D3
	DMU		VSS_5	J8		DMU		VSS_5	J8
			VSS_6					VSS_6
E3				M1	E3				M1
	DQL0		VSS_7	M9		DQL0		VSS_7	M9
F7					F7
	DQL1		VSS_8	P1		DQL1		VSS_8	P1
F2					F2
	DQL2		VSS_9	P9		DQL2		VSS_9	P9
F8					F8
	DQL3		VSS_10	T1		DQL3		VSS_10	T1
H3					H3
	DQL4		VSS_11	T9		DQL4		VSS_11	T9
H8					H8
	DQL5		VSS_12			DQL5		VSS_12
G2					G2
	DQL6					DQL6
H7					H7
	DQL7		VSSQ_1	B1		DQL7		VSSQ_1	B1
D7				B9	D7				B9
	DQU0		VSSQ_2	D1		DQU0		VSSQ_2	D1
C3					C3
	DQU1		VSSQ_3	D8		DQU1		VSSQ_3	D8
C8					C8
	DQU2		VSSQ_4	E2		DQU2		VSSQ_4	E2
C2					C2
	DQU3		VSSQ_5	E8		DQU3		VSSQ_5	E8
A7					A7
	DQU4		VSSQ_6	F9		DQU4		VSSQ_6	F9
A2					A2
	DQU5		VSSQ_7	G1		DQU5		VSSQ_7	G1
B8					B8
	DQU6		VSSQ_8	G9		DQU6		VSSQ_8	G9
A3					A3
	DQU7		VSSQ_9			DQU7		VSSQ_9

			IC1201-*2					IC1202-*2
	NT5CB64M16DP-CF						NT5CB64M16DP-CF
		DDR_1333_NANYA_NEW						DDR_1333_NANYA_NEW
N3					M8	N3				M8
	A0			EAN61857201 VREFCA			A0		EAN61857201 VREFCA
P7						P7
	A1						A1
P3						P3
	A2				H1		A2			H1
N2						N2
	A3			VREFDQ			A3		VREFDQ
P8						P8
	A4						A4
P2						P2
	A5				L8		A5			L8
R8						R8
	A6			ZQ			A6		ZQ
R2						R2
	A7						A7
T8						T8
	A8				B2		A8			B2
R3						R3
	A9			VDD_1	D9		A9		VDD_1	D9
L7						L7
	A10/AP			VDD_2	G7		A10/AP		VDD_2	G7
R7						R7
	A11			VDD_3	K2		A11		VDD_3	K2
N7						N7
	A12			VDD_4	K8		A12		VDD_4	K8
T3						T3
	NC_6			VDD_5	N1		NC_6		VDD_5	N1
				VDD_6					VDD_6
M7					N9	M7				N9
	NC_5			VDD_7	R1		NC_5		VDD_7	R1
				VDD_8					VDD_8
M2					R9	M2				R9
	BA0			VDD_9			BA0		VDD_9
N8						N8
	BA1						BA1
M3						M3
	BA2			VDDQ_1	A1		BA2		VDDQ_1	A1
J7					A8	J7				A8
	CK			VDDQ_2			CK		VDDQ_2
K7					C1	K7				C1
	CK			VDDQ_3	C9		CK		VDDQ_3	C9
K9						K9
	CKE			VDDQ_4	D2		CKE		VDDQ_4	D2
				VDDQ_5					VDDQ_5
L2					E9	L2				E9
	CS			VDDQ_6			CS		VDDQ_6
					F1					F1
K1						K1
	ODT			VDDQ_7			ODT		VDDQ_7
J3					H2	J3				H2
	RAS			VDDQ_8			RAS		VDDQ_8
K3					H9	K3				H9
	CAS			VDDQ_9			CAS		VDDQ_9
L3						L3
	WE			NC_1	J1		WE		NC_1	J1
T2					J9	T2				J9
	RESET			NC_2	L1		RESET		NC_2	L1
				NC_3					NC_3
					L9					L9
				NC_4					NC_4
F3					T7	F3				T7
	DQSL			NC_7			DQSL		NC_7
G3						G3
	DQSL						DQSL
C7					A9	C7				A9
	DQSU			VSS_1			DQSU		VSS_1
B7					B3	B7				B3
	DQSU			VSS_2	E1		DQSU		VSS_2	E1
				VSS_3					VSS_3
E7					G8	E7				G8
	DML			VSS_4	J2		DML		VSS_4	J2
D3						D3
	DMU			VSS_5			DMU		VSS_5

DDR_1600_SS

DDR_1600_SS

DDR_1600_HYNIX

DDR_1600_HYNIX

DDR_DVB_T2_2G

DDR_DVB_T2_2G

DDR_1600_MICRON

DDR_1600_MICRON

IC1201-*5

IC1202-*5

IC1201-*4

IC1202-*4

IC1201-*3

IC1202-*3

IC1201-*6

IC1202-*6

K4B1G1646G-BCK0

K4B1G1646G-BCK0

H5TQ1G63DFR-PBC

H5TQ1G63DFR-PBC

K4B2G1646C

K4B2G1646C

MT41J64M16JT-125:G

MT41J64M16JT-125:G

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

N3

A0

VREFCA

M8

P7

P7

P7

P7

P7

P7

P7

P7

P3

A1

P3

A1

P3

A1

P3

A1

P3

A1

P3

A1

P3

A1

P3

A1

N2

A2

H1

N2

A2

H1

N2

A2

H1

N2

A2

H1

N2

A2

H1

N2

A2

H1

N2

A2

H1

N2

A2

H1

P8

A3

VREFDQ

P8

A3

VREFDQ

P8

A3

VREFDQ

P8

A3

VREFDQ

P8

A3

VREFDQ

P8

A3

VREFDQ

P8

A3

VREFDQ

P8

A3

VREFDQ

P2

A4

P2

A4

P2

A4

P2

A4

P2

A4

P2

A4

P2

A4

P2

A4

R8

A5

L8

R8

A5

L8

R8

A5

L8

R8

A5

L8

R8

A5

L8

R8

A5

L8

R8

A5

L8

R8

A5

L8

R2

A6

ZQ

R2

A6

ZQ

R2

A6

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R2

A6

ZQ

R2

A6

ZQ

R2

A6

ZQ

R2

A6

ZQ

R2

A6

ZQ

T8

A7

T8

A7

T8

A7

T8

A7

T8

A7

T8

A7

T8

A7

T8

A7

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A8

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A8

B2

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A8

B2

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A8

B2

R3

A8

B2

R3

A8

B2

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A8

B2

R3

A8

B2

L7

A9

VDD_1

D9

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A9

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D9

L7

A9

VDD_1

D9

L7

A9

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D9

L7

A9

VDD_1

D9

L7

A9

VDD_1

D9

L7

A9

VDD_1

D9

L7

A9

VDD_1

D9

R7

A10/AP

VDD_2

G7

R7

A10/AP

VDD_2

G7

R7

A10/AP

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R7

A10/AP

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G7

R7

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VDD_2

G7

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A10/AP

VDD_2

G7

R7

A10/AP

VDD_2

G7

R7

A10/AP

VDD_2

G7

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A11

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N7

A11

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K2

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A11

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K2

N7

A11

VDD_3

K2

N7

A11

VDD_3

K2

N7

A11

VDD_3

K2

N7

A11

VDD_3

K2

N7

A11

VDD_3

K2

T3

A12/BC

VDD_4

K8

T3

A12/BC

VDD_4

K8

T3

A12/BC

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K8

T3

A12/BC

VDD_4

K8

T3

A12/BC

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T3

A12/BC

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T3

A12/BC

VDD_4

K8

T3

A12/BC

VDD_4

K8

A13

VDD_5

N1

A13

VDD_5

N1

A13

VDD_5

N1

A13

VDD_5

N1

A13

VDD_5

N1

A13

VDD_5

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NC_6

VDD_5

N1

NC_6

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M7

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M7

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M7

A15

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M7

NC_5

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M7

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N9

M7

A15

VDD_6

N9

VDD_7

R1

VDD_7

R1

VDD_7

R1

VDD_7

R1

VDD_7

R1

VDD_7

R1

VDD_7

R1

VDD_7

R1

M2

BA0

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M2

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VDD_8

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N8

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N8

VDD_9

N8

VDD_9

N8

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N8

VDD_9

N8

VDD_9

N8

VDD_9

M3

BA1

M3

BA1

M3

BA1

M3

BA1

M3

BA1

M3

BA1

M3

BA1

M3

BA1

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VDDQ_1

A1

BA2

VDDQ_1

A1

BA2

VDDQ_1

A1

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VDDQ_1

A1

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VDDQ_1

A1

BA2

VDDQ_1

A1

BA2

VDDQ_1

A1

BA2

VDDQ_1

A1

J7

CK

A8

J7

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A8

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A8

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A8

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A8

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A8

J7

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A8

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A8

K7

VDDQ_2

C1

K7

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K7

VDDQ_2

C1

K7

VDDQ_2

C1

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VDDQ_2

C1

K7

VDDQ_2

C1

K7

VDDQ_2

C1

K7

VDDQ_2

C1

K9

CK

VDDQ_3

C9

K9

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VDDQ_3

C9

K9

CK

VDDQ_3

C9

K9

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VDDQ_3

C9

K9

CK

VDDQ_3

C9

K9

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VDDQ_3

C9

K9

CK

VDDQ_3

C9

K9

CK

VDDQ_3

C9

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

CKE

VDDQ_4

D2

L2

CS

VDDQ_5

E9

L2

CS

VDDQ_5

E9

L2

CS

VDDQ_5

E9

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VDDQ_5

E9

L2

CS

VDDQ_5

E9

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CS

VDDQ_5

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L2

CS

VDDQ_5

E9

L2

CS

VDDQ_5

E9

K1

VDDQ_6

F1

K1

VDDQ_6

F1

K1

VDDQ_6

F1

K1

VDDQ_6

F1

K1

VDDQ_6

F1

K1

VDDQ_6

F1

K1

VDDQ_6

F1

K1

VDDQ_6

F1

J3

ODT

VDDQ_7

H2

J3

ODT

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H2

J3

ODT

VDDQ_7

H2

J3

ODT

VDDQ_7

H2

J3

ODT

VDDQ_7

H2

J3

ODT

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H2

J3

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H2

J3

ODT

VDDQ_7

H2

K3

RAS

VDDQ_8

H9

K3

RAS

VDDQ_8

H9

K3

RAS

VDDQ_8

H9

K3

RAS

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K3

RAS

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RAS

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K3

RAS

VDDQ_8

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VDDQ_9

L3

CAS

VDDQ_9

L3

CAS

VDDQ_9

L3

CAS

VDDQ_9

L3

CAS

VDDQ_9

L3

CAS

VDDQ_9

L3

CAS

VDDQ_9

L3

CAS

VDDQ_9

WE

NC_1

J1

WE

NC_1

J1

WE

NC_1

J1

WE

NC_1

J1

WE

NC_1

J1

WE

NC_1

J1

WE

NC_1

J1

WE

NC_1

J1

T2

J9

T2

J9

T2

J9

T2

J9

T2

J9

T2

J9

T2

J9

T2

J9

RESET

NC_2

L1

RESET

NC_2

L1

RESET

NC_2

L1

RESET

NC_2

L1

RESET

NC_2

L1

RESET

NC_2

L1

RESET

NC_2

L1

RESET

NC_2

L1

NC_3

L9

NC_3

L9

NC_3

L9

NC_3

L9

NC_3

L9

NC_3

L9

NC_3

L9

NC_3

L9

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

F3

DQSL

NC_4

T7

G3

NC_6

G3

NC_6

G3

NC_6

G3

NC_6

G3

NC_6

G3

NC_6

G3

NC_5

G3

NC_5

DQSL

DQSL

DQSL

DQSL

DQSL

DQSL

DQSL

DQSL

C7

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A9

C7

DQSU

VSS_1

A9

C7

DQSU

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A9

C7

DQSU

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A9

C7

DQSU

VSS_1

A9

C7

DQSU

VSS_1

A9

C7

DQSU

VSS_1

A9

C7

DQSU

VSS_1

A9

B7

B3

B7

B3

B7

B3

B7

B3

B7

B3

B7

B3

B7

B3

B7

B3

DQSU

VSS_2

E1

DQSU

VSS_2

E1

DQSU

VSS_2

E1

DQSU

VSS_2

E1

DQSU

VSS_2

E1

DQSU

VSS_2

E1

DQSU

VSS_2

E1

DQSU

VSS_2

E1

E7

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G8

E7

DML

VSS_3

G8

E7

DML

VSS_3

G8

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DML

VSS_3

G8

E7

DML

VSS_3

G8

E7

DML

VSS_3

G8

E7

DML

VSS_3

G8

E7

DML

VSS_3

G8

D3

VSS_4

J2

D3

VSS_4

J2

D3

VSS_4

J2

D3

VSS_4

J2

D3

VSS_4

J2

D3

VSS_4

J2

D3

VSS_4

J2

D3

VSS_4

J2

DMU

VSS_5

J8

DMU

VSS_5

J8

DMU

VSS_5

J8

DMU

VSS_5

J8

DMU

VSS_5

J8

DMU

VSS_5

J8

DMU

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DMU

VSS_5

J8

E3

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E3

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M1

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DQL0

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M1

E3

DQL0

VSS_6

M1

E3

DQL0

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M1

E3

DQL0

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E3

DQ0

VSS_6

M1

F7

VSS_7

M9

F7

VSS_7

M9

F7

VSS_7

M9

F7

VSS_7

M9

F7

VSS_7

M9

F7

VSS_7

M9

F7

VSS_7

M9

F7

VSS_7

M9

F2

DQL1

VSS_8

P1

F2

DQL1

VSS_8

P1

F2

DQL1

VSS_8

P1

F2

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P1

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VSS_8

P1

F2

DQL1

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P1

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VSS_8

P1

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DQ1

VSS_8

P1

F8

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P9

F8

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P9

F8

DQL2

VSS_9

P9

F8

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VSS_9

P9

F8

DQL2

VSS_9

P9

F8

DQL2

VSS_9

P9

F8

DQ2

VSS_9

P9

F8

DQ2

VSS_9

P9

H3

DQL3

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T1

H3

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T1

H3

DQL3

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T1

H3

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T1

H3

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T1

H3

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H3

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T9

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T9

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T9

H8

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T9

H8

DQ4

VSS_11

T9

G2

DQL5

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G2

DQL5

VSS_12

G2

DQL5

VSS_12

G2

DQL5

VSS_12

G2

DQL5

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G2

DQL5

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G2

DQ5

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H7

DQL6

H7

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H7

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DQL6

H7

DQL6

H7

DQL6

H7

DQ6

H7

DQ6

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B1

DQL7

VSSQ_1

B1

DQL7

VSSQ_1

B1

DQL7

VSSQ_1

B1

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B1

DQL7

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B1

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VSSQ_1

B1

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B1

D7

DQU0

B9

D7

DQU0

B9

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DQU0

B9

D7

DQU0

B9

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DQU0

B9

D7

DQU0

B9

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DQ8

B9

D7

DQ8

B9

C3

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D1

C3

VSSQ_2

D1

C3

VSSQ_2

D1

C3

VSSQ_2

D1

C3

VSSQ_2

D1

C3

VSSQ_2

D1

C3

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D1

C3

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D1

C8

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D8

C8

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D8

C8

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C8

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C2

DQU2

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E2

C2

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E2

C2

DQU2

VSSQ_4

E2

C2

DQU2

VSSQ_4

E2

C2

DQU2

VSSQ_4

E2

C2

DQU2

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E2

C2

DQ10

VSSQ_4

E2

C2

DQ10

VSSQ_4

E2

A7

DQU3

VSSQ_5

E8

A7

DQU3

VSSQ_5

E8

A7

DQU3

VSSQ_5

E8

A7

DQU3

VSSQ_5

E8

A7

DQU3

VSSQ_5

E8

A7

DQU3

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E8

A7

DQ11

VSSQ_5

E8

A2

DQU4

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F9

A2

DQU4

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F9

A2

DQU4

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F9

A2

DQU4

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F9

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F9

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F9

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F9

A2

DQ12

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F9

B8

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VSSQ_7

G1

B8

DQU5

VSSQ_7

G1

B8

DQU5

VSSQ_7

G1

B8

DQU5

VSSQ_7

G1

B8

DQU5

VSSQ_7

G1

B8

DQU5

VSSQ_7

G1

B8

DQ13

VSSQ_7

G1

B8

DQ13

VSSQ_7

G1

A3

DQU6

VSSQ_8

G9

A3

DQU6

VSSQ_8

G9

A3

DQU6

VSSQ_8

G9

A3

DQU6

VSSQ_8

G9

A3

DQU6

VSSQ_8

G9

A3

DQU6

VSSQ_8

G9

A3

DQ14

VSSQ_8

G9

A3

DQ14

VSSQ_8

G9

DQU7

VSSQ_9

DQU7

VSSQ_9

DQU7

VSSQ_9

DQU7

VSSQ_9

DQU7

VSSQ_9

DQU7

VSSQ_9

DQ15

VSSQ_9

DQ15

VSSQ_9

THE SYMBOL MARK OF THIS SCHEMETIC DIAGRAM INCORPORATES

SPECIAL FEATURES IMPORTANT FOR PROTECTION FROM X-RADIATION.

FILRE AND ELECTRICAL SHOCK HAZARDS, WHEN SERVICING IF IS

ESSENTIAL THAT ONLY MANUFATURES SPECFIED PARTS BE USED FOR

THE CRITICAL COMPONENTS IN THE SYMBOL MARK OF THE SCHEMETIC.

	J8		J8
E3	VSS_6	E3	VSS_6
	M1		M1
DQL0	VSS_7	DQL0	VSS_7
F7	M9	F7	M9
DQL1	VSS_8	DQL1	VSS_8
F2	P1	F2	P1
DQL2	VSS_9	DQL2	VSS_9
F8	P9	F8	P9
DQL3	VSS_10	DQL3	VSS_10
H3	T1	H3	T1
DQL4	VSS_11	DQL4	VSS_11
H8	T9	H8	T9
DQL5	VSS_12	DQL5	VSS_12
G2		G2
DQL6		DQL6
H7		H7
DQL7	B1	DQL7	B1
D7	VSSQ_1	D7	VSSQ_1
	B9		B9
DQU0	VSSQ_2	DQU0	VSSQ_2
C3	D1	C3	D1
DQU1	VSSQ_3	DQU1	VSSQ_3
C8	D8	C8	D8
DQU2	VSSQ_4	DQU2	VSSQ_4
C2	E2	C2	E2
DQU3	VSSQ_5	DQU3	VSSQ_5
A7	E8	A7	E8
DQU4	VSSQ_6	DQU4	VSSQ_6
A2	F9	A2	F9
DQU5	VSSQ_7	DQU5	VSSQ_7
B8	G1	B8	G1
DQU6	VSSQ_8	DQU6	VSSQ_8
A3	G9	A3	G9
DQU7	VSSQ_9	DQU7	VSSQ_9

GP4L_S7LR22011/06/03

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