6. DIGITAL CIRCUIT
6-1. Outline
AConfiguration of digital circuit is shown in Fig.
QX202, 203, 205, 206 MB814265/HM514265 (MEMORY)
R signal | QX201 | QX204 | QX207 | QX208 | R signal | |
CXA3026Q | EPM7064LC68 | MB40950 | ||||
(2.0V - 4.0V) | (3.0V - 5.0V) | |||||
(A/D CONV.) |
| (EXCHANGE) | (D/A CONV.) | |||
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| 1/2 CLK |
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| R CHANNEL |
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G signal |
| G CHANNEL (RX4**, CX4**, QX4**) |
| G signal | ||
(2.0V - 4.0V) |
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| (3.0V - 5.0V) | |||
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| |||
B signal |
| B CHANNEL (RX6**, CX6**, QX6**) |
| B signal | ||
(2.0V - 4.0V) |
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| ||||
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| (3.0V - 5.0V) | ||
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| 42 MHz |
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| System clock |
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| CLK (PECL) |
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| for |
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FREEZE |
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| ZX003 |
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| QX003 |
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| 42 MHz |
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| ON SCREEN |
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(MPU or camera) |
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| X'tal OSC |
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| DISPLAY |
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VD |
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| VD (INPUT) |
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| VD (PANEL) |
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| HD (INPUT) |
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| HD (PANEL) |
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| ||||||||
HD |
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| QX004 |
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| QX009 |
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| LCD panel |
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| Timing signals | |||||||||||||
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| TC160G54AF1137 |
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| clock | EMP7160ELC84 |
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| QX028 | 1/2 CLK |
| (SYG) |
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| (TIMING) |
| for LCD drive | ||||||||||
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| CXA3106Q |
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| (PLL IC) |
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| Reference clock | Reference |
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For RGB signal |
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| for signal format | clock for |
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| measurement | LCD drive |
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| QX029 |
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| ZX003 |
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| QX008 |
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| 32.5 MHz |
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| TLC2932 |
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| ||||||||
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|
| TLC2932 |
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| ||||||||||
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| X'tal OSC |
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| (PLL IC) |
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| (PLL IC) |
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| ||||||||||
For VIDEO signal |
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| |||
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Fig.