Cypress CY7C1332AV25 manual Scan Register Sizes, Instruction Codes, Boundary Scan Order 1 Mbit x

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CY7C1330AV25

 

 

 

 

 

 

 

 

 

 

 

PRELIMINARY

 

 

CY7C1332AV25

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Scan Register Sizes

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Register Name

 

 

 

 

Bit Size—CY7C1330AV25

 

 

Bit Size—CY7C1332AV25

 

Instruction

 

 

 

 

 

 

 

 

3

 

 

 

3

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Bypass

 

 

 

 

 

 

 

 

1

 

 

 

1

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

ID

 

 

 

 

 

 

 

 

32

 

 

 

32

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Boundary Scan

 

 

 

 

 

 

 

 

70

 

 

 

51

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Instruction Codes

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Instruction

 

 

 

 

Code

 

 

 

Description

 

 

EXTEST

 

 

 

 

000

 

 

Captures the Input/Output ring contents.

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

IDCODE

 

 

 

 

001

 

 

Loads the ID register with the vendor ID code and places the register between TDI

 

 

 

 

 

 

 

 

 

 

 

and TDO. This operation does not affect SRAM operation.

 

 

SAMPLE Z

 

 

 

 

010

 

 

Captures the Input/Output contents. Places the boundary scan register between

 

 

 

 

 

 

 

 

 

 

 

TDI and TDO. Forces all SRAM output drivers to a High-Z state.

 

 

RESERVED

 

 

 

 

011

 

 

Do Not Use: This instruction is reserved for future use.

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

SAMPLE/PRELOAD

 

 

 

 

100

 

 

Captures the Input/Output ring contents. Places the boundary scan register

 

 

 

 

 

 

 

 

 

 

 

between TDI and TDO. Does not affect the SRAM operation.

 

 

RESERVED

 

 

 

 

101

 

 

Do Not Use: This instruction is reserved for future use.

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

RESERVED

 

 

 

 

110

 

 

Do Not Use: This instruction is reserved for future use.

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

BYPASS

 

 

 

 

111

 

 

Places the bypass register between TDI and TDO. This operation does not affect

 

 

 

 

 

 

 

 

 

 

 

SRAM operation.

 

 

 

 

 

 

 

Boundary Scan Order (1 Mbit x 18)

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Bit #

 

Bump ID

 

 

 

 

Bit #

 

Bump ID

 

 

Bit #

 

Bump ID

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

1

 

5R

 

 

 

 

18

 

7E

 

 

35

 

1H

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

2

 

6T

 

 

 

 

19

 

6D

 

 

36

 

3G

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

3

 

4P

 

 

 

 

20

 

6A

 

 

37

 

4D

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

4

 

6R

 

 

 

 

21

 

6C

 

 

38

 

4E

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

5

 

5T

 

 

 

 

22

 

5C

 

 

39

 

4G

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

6

 

7T

 

 

 

 

23

 

5A

 

 

40

 

4H

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

7

 

7P

 

 

 

 

24

 

6B

 

 

41

 

4M

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

8

 

6N

 

 

 

 

25

 

5B

 

 

42

 

2K

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

9

 

6L

 

 

 

 

26

 

3B

 

 

43

 

1L

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

10

 

7K

 

 

 

 

27

 

2B

 

 

44

 

2M

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

11

 

5L

 

 

 

 

28

 

3A

 

 

45

 

1N

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

12

 

4L

 

 

 

 

29

 

3C

 

 

46

 

2P

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

13

 

4K

 

 

 

 

30

 

2C

 

 

47

 

3T

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

14

 

4F

 

 

 

 

31

 

2A

 

 

48

 

2R

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

15

 

6H

 

 

 

 

32

 

1D

 

 

49

 

4N

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

16

 

7G

 

 

 

 

33

 

2E

 

 

50

 

2T

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

17

 

6F

 

 

 

 

34

 

2G

 

 

51

 

3R

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

Document No: 001-07844 Rev. *A

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Contents Functional Description FeaturesConfiguration Logic Block DiagramUnit Pin Configurations Ball BGA 14 x 22 x 2.4 mmMaximum Access Time Maximum Operating Current Selection GuideSerial clock to the Jtag circuit No connects Pin DefinitionsName Type Description Byte Write Select Inputs, active LOW. Qualified withFunctional Overview Sleep ModeIntroduction Write Cycle Descriptions1 ZZ Mode Electrical CharacteristicsCycle Description Truth , 2, 3, 4 Write Cycle Descriptions 1Ieee 1149.1 Serial Boundary Scan Jtag Extest EXIT2-IR UPDATE-DR UPDATE-IR TAP Controller State Diagram6Set-up Times TAP Controller Block DiagramTAP Electrical Characteristics Over the Operating Range7, 8 Parameter Description Min Max UnitOutput Times TAP Timing and Test Conditions11Identification Register Definitions Parameter Description MinBoundary Scan Order 1 Mbit x Scan Register SizesInstruction Codes Boundary Scan Order 512K x Ambient Range Electrical Characteristics Over the Operating RangeMaximum Ratings Operating RangeParameter Description Test Conditions Max Unit Capacitance17Thermal Resistance17 AC Test Loads and WaveformsClock Switching Characteristics 18, 19, 20250 200 Parameter Description Unit Min Max = DON’T Care = Undefined Switching WaveformsREAD/WRITE/DESELECT Sequence OE Controlled23, 24, 25 Originally Deselected READ/WRITE/DESELECT Sequence CE ControlledBall Pbga 14 x 22 x 2.4 mm Package DiagramOrdering Information Document History ECN No Issue Date Orig. Description of ChangeNew data sheet Minor change Moved data sheet to web