Cypress CY7C1473V33, CY7C1475V33 manual Pin Configurations Pin Tqfp Pinout, CY7C1471V33

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CY7C1471V33

CY7C1473V33

CY7C1475V33

Pin Configurations

100-Pin TQFP Pinout

BYTE C

BYTE D

DQPC

DQC

DQC

VDDQ

VSS

DQC DQC DQC DQC

VSS VDDQ

DQC DQC

NC

VDD

NC

VSS

DQD

DQD

VDDQ

VSS

DQD DQD DQD DQD

VSS VDDQ

DQD DQD

DQPD

A

A

CE

CE

BW

BW

BW

BW

 

CE

V

V

CLK

WE

CEN

OE

 

ADV/LD

A

A

A

A

 

 

 

 

 

 

 

 

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D

C

B

A

3

 

 

DD

 

SS

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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MODE

 

A

A

 

A

A

A1

A0

NC/288M

 

NC/144M

 

V

 

V

 

A

A

A

A

 

 

A

 

A

 

A

A

 

A

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

SS

 

DD

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

DQPB

DQB DQB

VDDQ

VSS

DQB DQB DQB DQB

VSS

VDDQ

DQB DQB

VSS

NC

VDD

ZZ

DQA DQA

VDDQ

VSS

DQA DQA DQA DQA

VSS

VDDQ

DQA DQA DQPA

BYTE B

BYTE A

Document #: 38-05288 Rev. *J

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Contents Features Functional DescriptionSelection Guide 133 MHz 117 MHz UnitLogic Block Diagram CY7C1471V33 2M x Logic Block Diagram CY7C1473V33 4M xLogic Block Diagram CY7C1475V33 1M x Pin Configurations Pin Tqfp Pinout CY7C1471V33CY7C1473V33 CY7C1473V33 4M x ADV/LD Pin Definitions Single Read Accesses Burst Read AccessesSingle Write Accesses Functional OverviewLinear Burst Address Table Mode = GND Interleaved Burst Address Table Mode = Floating or VDDZZ Mode Electrical Characteristics Address Operation Truth TableUsed Function Truth Table for Read/WriteFunction BW b BW a TAP Controller Block Diagram TAP Controller State DiagramIeee 1149.1 Serial Boundary Scan Jtag TAP Registers TAP Instruction SetTAP Timing BypassTAP AC Switching Characteristics Parameter Description Min Max Unit ClockOutput Times Hold TimesTAP DC Electrical Characteristics And Operating Conditions 3V TAP AC Test Conditions5V TAP AC Test Conditions Parameter Description Test Conditions MinScan Register Sizes Identification Register DefinitionsIdentification Codes Boundary Scan Exit Order 4M x Boundary Scan Exit Order 2M xBit # Ball ID Boundary Scan Exit Order 1M x P10W10 V10Electrical Characteristics Maximum RatingsOperating Range Range AmbientThermal Resistance CapacitanceAC Test Loads and Waveforms Setup Times Switching CharacteristicsDescription 133 MHz 117 MHz Unit Parameter Min Max Rite Switching WaveformsRead Address QA2Stall Stall NOPDON’T Care Ordering Information Package Diagrams Pin Thin Plastic Quad Flatpack 14 x 20 x 1.4 mmBall Fbga 15 x 17 x 1.4 mm Ball Fbga 14 x 22 x 1.76 mm Issue Orig. of Change Description of Change Date Document HistoryVKN VKN/AESA