TMS380C26
NETWORK COMMPROCESSOR
SPWS010A±APRIL 1992±REVISED MARCH 1993
PARAMETER MEASUREMENT INFORMATION
80x8x DIO read timing
NO. |
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| PARAMETER | MIN | MAX | UNIT | |||||||||||
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255 | Delay from |
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| low to either |
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| or |
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| high | 15 |
| ns | |||||||||||||||||||||||||||||||||
SRDY | SCS |
| SRD |
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| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
256 | Pulse duration, SRAS high | 30 |
| ns | ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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259² | Hold of SAD |
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| low (see Note 21) | 0 |
| ns | ||||||||||||||||||||||||||||||||||||||||||||||||||||||
SRD |
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| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
260 | Setup of SADH0±SADH7, SADL0±SADL7, SPH and SPL valid before |
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| low | 0 |
| ns | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
SRDY |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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261² | Delay from |
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| or |
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| high to SAD |
| 35 | ns | |||||||||||||||||||||||||||||||||||||||||||||||||||
SRD |
| SCS |
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| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
261a | Hold of output data valid after |
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| or |
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| high (see Note 21) | 0 |
| ns | ||||||||||||||||||||||||||||||||||||||||||
SRD |
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| SCS |
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| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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264 | Setup of SRSX, SRS0±SRS2, |
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| and |
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| valid to SRAS no longer high (see Note 22) | 30 |
| ns | |||||||||||||||||||||||||||||||||||||||||
SCS, |
| SBHE |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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265 | Hold of SRSX, SRS0±SRS2, |
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| and |
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| valid after SRAS low | 15 |
| ns | ||||||||||||||||||||||||||||||||||||||||||
SCS, |
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| SBHE |
| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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266a | Setup of SRAS high to |
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| no longer high (see Note 22) | 25 |
| ns | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||
SRD |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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267³ | Setup of SRSX, SRS0±SRS2 valid before |
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| no longer high (see Note 21) | 15 |
| ns | ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
SRD |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
268 | Hold of SRSX, SRS0±SRS2 valid after |
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| no longer low (see Note 22) | 0 |
| ns | ||||||||||||||||||||||||||||||||||||||||||||||||||||||||
SRD |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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272a | Setup time of |
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| and |
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| high from previous cycle to |
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| no longer high | 55 |
| ns | ||||||||||||||||||||||||||||||
SRD, |
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| SWR, |
| SIACK | SRD |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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273a | Hold time of |
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| and |
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| high after |
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| high | 55 |
| ns | ||||||||||||||||||||||||||
SRD, |
| SWR, |
| SIACK | SRD |
| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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275 | Delay from |
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| and |
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| or |
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| high to |
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| high (see Note 21) |
| 35 | ns | ||||||||||||||||||||||||||||||
SRD | SWR, | SCS |
| SRDY |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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279² | Delay from |
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| and |
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| high to |
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| high impedance |
| 65 | ns | ||||||||||||||||||||||||||||||||||||||
SRD | SWR, | SRDY |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
282a | Delay from |
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| low to |
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| low in a read cycle |
| 35 | ns | ||||||||||||||||||||||||||||||||||||||||||
SDBEN | SRDY |
| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
| Delay from |
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| low to |
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| low (see TMS380 Second Generation |
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282R | SRD | SDBEN |
| 55 | ns | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
SPWU005, subsection 3.4.1.1.1), provided previous cycle completed. |
| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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| |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
283R | Delay from |
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| high to |
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| high (see Note 21) |
| 35 | ns | |||||||||||||||||||||||||||||||||||||||||||||
SRD | SDBEN |
| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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| ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
286 | Pulse duration, |
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| high between DIO accesses (see Note 21) | 55 |
| ns | |||||||||||||||||||||||||||||||||||||||||||||||||||||||
SRD |
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²This specification is provided as an aid to board design.
³ It is the later of SRD and SWR or SCS low that indicates the start of the cycle.
NOTES: 21. The ªinactiveº chip select is SIACKin DIO read and DIO write cycles, and SCS is the ªinactiveº chip select in interrupt acknowledge cycles.
22.In 80x8x mode, SRAS may be used to strobe the values of SBHE, SRSX, SRS0 ± SRS2, and SCS. When used to do so, SRAS must meet parameter 266a, and SBHE, SRS0±SRS2, and SCS must meet parameter 264. If SRAS is strapped high, then parameters 266a and 264 are irrelevant, and parameter 268 must be met.
POST OFFICE BOX 1443 •HOUSTON, TEXAS | 61 |
77251±1443 |
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