5.6.2Multiword data transfer
Figure 5.9 shows the multiword DMA data transfer timing between the device and the host system.
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DMACK- |
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Write data |
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| tG | tH |
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Read data |
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| tE |
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| tF |
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t0 | Cycle time |
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| 120 |
| — | ns | |||||||||||||||||||||||
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tC | Delay time from DMACK assertion to DMARQ negation |
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| 35 | ns | |||||||||||||||||||||||||||||
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tD | Pulse width of |
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| 70 |
| — | ns | |||||||||||||||||||||||
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tE | Data setup time for DIOR- |
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| 30 | ns | |||||||||||||||||
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tF | Data hold time for DIOR- |
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| 5 |
| — | ns | |||||||||||||||||||||||
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tG | Data setup time for DIOW- |
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| 20 |
| — | ns | |||||||||||||||||||||||
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tH | Data hold time for DIOW- |
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| 10 |
| — | ns | |||||||||||||||||||||||
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tI | DMACK setup time for |
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| 0 |
| — | ns | |||||||||||||||||||||||||
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tJ | DMACK hold time for |
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| 5 |
| — | ns | |||||||||||||||||||||||
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tK | Continuous time of high level for |
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| — | ns | |||||||||||||||||||||||||||||||||||
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Figure 5.9 Multiword DMA data transfer timing (mode 2)
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