5.6Timing
5.6.1PIO data transfer
Figure 5.8 shows of the data transfer timing between the device and the host system.
t0
Addresses
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Write data |
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Read data |
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| t5 |
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IORDY |
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| t10 |
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| t11 |
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| t12 |
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Symbol |
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t0 |
| Cycle time |
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| 120 | — |
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| ns |
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t1 |
| Data register selection setup time for |
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| 25 | — |
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| ns |
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t2 |
| Pulse width of |
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| 70 | — |
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| ns |
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t2i |
| Recovery time of |
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| 25 | — |
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| ns |
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t3 |
| Data setup time for DIOW- |
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| 20 | — |
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| ns |
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t4 |
| Data hold time for DIOW- |
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| 10 | — |
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| ns |
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t5 |
| Time from DIOR- assertion to read data available |
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| — | 50 |
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| ns |
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t6 |
| Data hold time for DIOR- |
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| 5 | — |
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| ns |
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t9 |
| Data register selection hold time for |
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| 10 | — |
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| ns |
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t10 |
| Time from |
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| — | 35 |
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| ns |
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t11 |
| Time from validity of read data to IORDY "high" level |
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| 0 | — |
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| ns |
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t12 |
| Pulse width of IORDY |
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| — | 1,250 |
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Figure 5.8 PIO data transfer timing
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