Cypress CY7C1373D, CY7C1371D manual

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CY7C1371D

CY7C1373D

Pin Configurations (continued)

100-Pin TQFP Pinout

BYTE B

NC

NC

NC

VDDQ

VSS

NC NC

DQB

DQB

VSS VDDQ

DQB DQB

NC

VDD

NC

VSS

DQB

DQB

VDDQ

VSS

DQB DQB

DQPB

NC

VSS VDDQ

NC

NC

NC

A

A

CE

CE

NC

NC

BW

BW

CE

V

V

CLK

WE

CEN

OE

 

ADV/LD

A

A

A

A

 

 

 

 

 

 

 

1

 

2

 

 

 

 

 

B

A

3

 

 

DD

 

SS

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

100

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13

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 

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MODE

 

A

A

 

A

 

A

A1

A0

NC/288M

NC/144M

 

SS

 

DD

 

NC/72M

NC/36M

A

A

 

 

A

 

A

 

A

A

 

A

 

 

 

 

 

V

 

V

 

 

 

 

 

 

A

NC

NC

VDDQ

VSS

NC DQPA

DQA DQA

VSS

VDDQ

DQA DQA

VSS

NC

VDD

ZZ

DQA DQA

VDDQ

VSS

DQA DQA NC

NC

VSS

VDDQ

NC

NC

NC

BYTE A

Document #: 38-05556 Rev. *F

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Image 4
Contents Features Selection Guide Functional Description1133 MHz 100 MHz Unit Cypress Semiconductor CorporationLogic Block Diagram CY7C1371D 512K x Logic Block Diagram CY7C1373D 1M xPin Configurations Pin Tqfp Pinout CY7C1371DCY7C1373D Pin Configurations Pin Configurations Ball Fbga Pinout CE2Pin Definitions Single Read Accesses Burst Read AccessesSingle Write Accesses Functional OverviewLinear Burst Address Table Mode = GND Interleaved Burst Address Table Mode = Floating or VDDZZ Mode Electrical Characteristics Partial Truth Table for Read/Write 2, 3 Address Operation UsedFunction CY7C1371D Function CY7C1373DTAP Controller State Diagram TAP Controller Block Diagram Ieee 1149.1 Serial Boundary Scan JtagBypass Register TAP Instruction SetTAP Timing Extest Output Bus Tri-StateTAP AC Switching Characteristics Over the Operating Range10 Setup TimesParameter Description Min Max Unit Clock Output Times3V TAP AC Test Conditions TAP DC Electrical Characteristics And Operating ConditionsParameter Description Conditions Min Max Unit Identification Register Definitions Scan Register SizesIdentification Codes Register Name Bit SizeBall BGA Boundary Scan Order 13 Bit # Ball IDA10 B10 P10 Electrical Characteristics Maximum RatingsOperating Range Ambient RangeThermal Resistance18 Capacitance18AC Test Loads and Waveforms Switching Characteristics Over the Operating Range23 133 MHz 100 MHz Parameter Description Unit Min MaxSwitching Waveforms Read/Write Waveforms25, 26Rite ReadNOP, Stall and Deselect Cycles25, 26 AddressStall Stall NOPZZ Mode Timing29 DON’T CareOrdering Information Package Diagrams Pin Thin Plastic Quad Flatpack 14 x 20 x 1.4 mmBall BGA 14 x 22 x 2.4 mm Ball Fbga 13 x 15 x 1.4 mm Issue Orig. Description of Change Date Document History