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ADuC812
Parameter |
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SPI SLAVE MODE TIMING (CPHA = 0) |
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tSS | SS to SCLOCK Edge |
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| 0 |
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| ns | 60 | ||||||||
tSL | SCLOCK Low Pulsewidth |
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| 330 |
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| ns | 60 | ||||||||||||
tSH | SCLOCK High Pulsewidth |
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| 330 |
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| ns | 60 | ||||||||||||
tDAV | Data Output Valid after SCLOCK Edge |
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| 50 |
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| ns | 60 | ||||||||||||||||||
tDSU | Data Input Setup Time before SCLOCK Edge | 100 |
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| ns | 60 | |||||||||||||
tDHD | Data Input Hold Time after SCLOCK Edge | 100 |
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| ns | 60 | |||||||||||||
tDF | Data Output Fall Time |
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| 10 |
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| ns | 60 | |||||||||||||||||
tDR | Data Output Rise Time |
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| 10 |
| 25 |
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| ns | 60 | |||||||||||||||||
tSR | SCLOCK Rise Time |
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| 10 |
| 25 |
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| ns | 60 | |||||||||||||||||
tSF | SCLOCK Fall Time |
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| 10 |
| 25 |
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| ns | 60 | |||||||||||||||||
tDOSS | Data Output Valid after SS Edge |
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| 20 |
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| ns | 60 | |||||||||||||
tSFS | SS High after SCLOCK Edge |
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| ns | 60 | ||||||||
| SS |
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| tSS |
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| SCLOCK |
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| (CPOL=0) |
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| tSR |
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| t | SF |
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| SCLOCK |
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| (CPOL=1) |
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tDAV
tDOSS
tDF tDR
MISO
MSB
BIT 6 – 1 | LSB |
MOSI
MSB IN
BIT 6 – 1 | LSB IN |
tDSU tDHD
Figure 59. SPI Slave Mode Timing (CPHA = 0)
REV. B |